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2015 Cadence 新技术研讨会北京站顺利举办

元器件交易网讯 6月17日,由科通主办的“2015 Cadence OrCAD,Allegro以及Sigrity新技术研讨会”在北京丽亭花苑酒店顺利举办,一百多位电子行业的PCB设计工程师、电源仿真及设计工程师、CAD工程师及经理参加了本次活动。

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Cadence工程师现场进行讲解

研讨会期间,来自科通以及Cadence的应用工程师分别进行了“Allegro New Tech Training”、“OrCAD EngineeringData Management”、“OrCAD Library Builder”、“OrCAD Panel Editor”、“What's new for PSpice”、“What's new in Sigrity”的主题演讲,与现场观众分享了最新的Cadence技术:

随着产品的日益革新,市场要求的不断提高,设计师们已经不能像以前那样简单的画完原理图导入后期进行布线,现在面临的挑战也越来越多。

“OrCAD Engineering DataManagement”(EDM)对于OrCAD CapturePCB原理图设计方案是一个全面的协作和管理环境。OrCAD EDM完全嵌入OrCAD Capture,得益于高效的涉及数据管理可以让工程设计团队在上市时间方面更有优势。该解决方案同时也消除了多个用户之间管理设计文件的挑战。

“OrCAD Library Builder”对于OrCAD原理图和PCB Layout提供了先进的、高度自动化快捷创建器件原理图符号和封装的解决方案。它从根本上消除了手动流程引入的错误,有利于提高设计质量和减少返工。

“OrCAD Panel Editor”是一个PCB制版设计工具,它将拼版、文档编制的复杂流程智能化、自动化,简化设计流程,产生简单或者复杂的PCB装配版图,相对传统的手工操作方式可以节省很多时间。OrCAD PanelEditor使用户能快速地设计PCB版图,创建生产图示,指导PCB制板及装配。

“What’s new for the PSpice 2015”:对于较大型的设计,PCB设计团队尤其需要快捷可靠的仿真,以完成设计任务。

最新的PSpice具有丰富的模型库,支持多核计算,进一步减少了用户仿真实践。并且和OrCAD Capture无缝链接,保证了数据的完整性。Cadence PSpice设计仿真技术提供了一个全功能的模拟仿真器,并支持数字元件帮助解决几乎所有的设计挑战̶̶从高频系统到低功耗IC设计。这个强大的仿真引擎可以容易地同各个Cadence PCB原理图输入工具结合,加速了上市时间并控制了运作成本。它交互式、易于使用的图形用户界面可提供对设计过程的完全控制。来自多家厂商的模型支持、内置数学函数和行为建模技术等资源的可用性促成了高效的设计过程,在仿真器之上建立先进的分析特性(敏感性, 蒙特卡洛, 应力分析和带有多个引擎的优化器)改善了设计性能、成本效益和可靠性。

“What’s new for ASI16.64 and Sigrity2015”:本次研讨会上,演讲嘉宾介绍了 ASI16.64和即将发布的Sigrity2015的诸多新功能,包括AMM分析模型库的应用,PowerDC与Voltus的热混合分析技术,3DFEM建模中的全新Cut-and-Stitch技术,应用了3DFEM技术的SPEED2000时域仿真和XtractIM封装模型提取,SystemSI仿真中的Test Bench、BER、DDR4和LPDDR4新技术模块,以及T2B对IBIS6.0模型的支持等。

 

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责任编辑:常慧思